ares10的博客

在几个月的努力工作后，我们终于完成了我们的项目：WCDMA系统数字频域干扰抵消器。我们来自WFIC团队，制作了我们项目的一段演示视频，大家快来看啊。 由于视频太大，因此分为两段，地址分别为：1。第一段 http://v.youku.com/v_show/id_co00XMjE4OTk1MzI=.html 2。第二段http://v.youku.com/v_show/id_co00XMjE4OTg4NjQ=.html

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人生成熟的四个重要标志 　成熟似乎是一件很残酷的事情，它代表了青春的流失和梦想的褪色。可是，走向成熟是人生的方向，况且，一种持久的平和的幸福人生离不开成熟。 1、"轻视异性" 能够“轻视”异性，不把异性当回事，这是成熟的标志，所以把它放在第一条，因为它是人生迈向成熟的第一步能够不把异性当回事，这对于人们、尤其对于青少年来说，是困难的，唯其难，所以它才成为一种成熟的象征。 这里说“轻视异性”，不是指性别歧视，它既指男人不要把女人当回事，也指女人不要把男人当回事。肤浅的人可能会...

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下面是自己写verilog代码的一些经验和小结。和大家分享下。1、对于高速的逻辑操作（如：判断，取反等），为了保证逻辑正确和结果的稳定（不抖动），需要用 always的 case语句来实现，而不要使用 if…else…，或者assign 语句的（）？… ：…形式。也即，对于高速数据的判断选择性操作，用case比用if…else…可以满足更高的时钟要求，但占用较多的slice；同一种逻辑操作，用同步赋值语句always比用assign可以满足更高的时钟要求。所需要的代价就是需要多增加一些触发器，因为只有触发器可以用 always赋...

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