XuWenbo的博客

在几个月的努力工作后，我们终于完成了我们的项目：WCDMA系统数字频域干扰抵消器。我们来自WFIC团队，制作了我们项目的一段演示视频，大家快来看啊。 由于视频太大，因此分为两段，地址分别为：1。第一段 http://v.youku.com/v_show/id_co00XMjE4OTk1MzI=.html 2。第二段http://v.youku.com/v_show/id_co00XMjE4OTg4NjQ=.html

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在比尔-盖茨写给高中毕业生和大学毕业生的书里，有一个单子上面列有11项学生没能在学校里学到的事情。比尔-盖茨在书中谈到让你感觉良好的政治上正确的教导培养出一整代不知现实为何物的年轻人，这种教育只能导致他们成为现实世界中的失败者。　　The 11 things are:　　这11项事情是：　　Life is not fair, get used to it.　　生活是不公平的；要去适应它。　　The world wont care about your self-esteem. The world will expect you to accomplish something before you feel good about yourself.　　这世界并不会在意你的自尊。这世...

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一个有关WCDMA网络下的小区搜索过程： 1、时隙同步－所有小区都使用相同的主同步码（PSC）－主同步信道没有经过扩频与加扰－同步信道的特性－匹配滤波器的输出界定了不同时隙的边界，但此时尚不知道无线帧的边界 2、帧同步－从同步码（SSC）共有16组，这16组码在1个无线帧的15个时隙中以一定的组合进行排列，这样的组合共有64种－主扰码共有512个，分为64组，每组8个主扰码－从同步信道使用第8组从同步信道码的话，那么该小区使用的主扰码就是第8组中的一个－从同步信道的64种组合中，不会有任何两种在移位后会相同，即每种组合都是唯一的...

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一、引言 1、组播技术引入的必要性 　　随着宽带多媒体网络的不断发展，各种宽带网络应用层出不穷。IP TV、视频会议、数据和资料分发、网络音频应用、网络视频应用、多媒体远程教育等宽带应用都对现有宽带多媒体网络的承载能力提出了挑战。采用单播技术构建的传统网络已经无法满足新兴宽带网络应用在带宽和网络服务质量方面的要求，随之而来的是网络延时、数据丢失等等问题。此时通过引入IP组播技术，有助于解决以上问题。组播网络中，即使组播用户数量成倍增长，骨干网络中网络带宽也无需增加。简单来说，成百上千的组播应用用户和一个组...

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状态机要写成3段式的(这是最标准的写法)，即         ……        //build the state flops  always @(posedge clk or negedge rst_n)                   ……             current_state <= next_state;         ……//state machine...

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单口RAM,只有一套地址总线,读和写是分开的.(不能在同一个周期).双口RAM分为两种:A　两套地址总线,一套D,Q 一个口只能写,一个口只能读;                                B    两套地址总线,两套D,Q两个口都可以读写;                    &...

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DSP基础--定点小数运算在DSP世界中，由于DSP芯片的限制,经常使用定点小数运算。所谓定点小数，实际上就是用整数来进行小数运算。下面先介绍定点小数的一些理论知识，然后以C语言为例，介绍一下定点小数运算的方法。在TI C5000 DSP系列中使用16比特为最小的储存单位，所以我们就用16比特的整数来进行定点小数运算。        先从整数开始，16比特的储存单位最多可以表示0x0000到0xffff，65536种状态，如果它表示C语言中的无符号整数的话，就是从0到65535。如果需要表示负数的话，那么最高位就...

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数字地和模拟地的区别模拟电路涉及弱小信号，但是数字电路门限电平较高，对电源的要求就比模拟电路低些。既有数字电路又有模拟电路的系统中，数字电路产生的噪声会影响模拟电路，使模拟电路的小信号指标变差，克服的办法是分开模拟地和数字地。      对于低频模拟电路，除了加粗和缩短地线之外，电路各部分采用一点接地是抑制地线干扰的最佳选择，主要可以防止由于地线公共阻抗而导致的部件之间的互相干扰。而对于高频电路和数字电路，由于这时地线的电感效应影响会更大，一点接地会导致实际地线加长而...

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在verilog语言教材中，最常用的两种变量类型是wire和reg，对于wire，大家都比较容易理解，即互连的“线”信号，但对于“reg”是否就一定是寄存器呢，更通俗地说，在FPGA是否就体现为D触发器或锁存器呢。可能受如下语句的影响：reg        abc_reg;always @ ( posedge clk or negedge rest_n )begin    if ( reset_n == 1'b0 )        abc_reg <= 1'b0;    else       &...

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